FPGA基础知识
1. 什么是综合？
综合就是把HDL语言/原理图转换为综合网表的过程。
2. 什么是综合网表？
综合网表就是综合的结果啦。
综合网表的业界标准是EDIF格式。文件后缀通常为.edn, .edf, .edif。EDIF网表是可以用文本编辑器打开的文本文件。
Xilinx自家的综合结果是NGC网表。NGC网表是二进制的文件，不能用文本编辑器打开观察。
3. 综合网表中包含一些什么内容？
综合网表中除了包含从HDL语言中infer出的与门、非门等组合逻辑和寄存器等时序逻辑之外，还包含FPGA特有的各种原语(Primitive)比如LUT，BRAM，DSP48，甚至PowerPC，PCIe等硬核模块，以及这些模块的属性和约束信息。
4. 综合工具有哪些？
Xilinx自家的XST，Synopsys(收购了Synplicity)的Synplify，Mentor Graphic的Precision 都是使用最广泛的综合工具。
5. 这些综合工具有什么特点呢？
XST - 随ISE自带，免费，对新器件支持快。但是对loop循环支持不如Synpilfy。综合结果的时序有时没有Synplify好。
Synplify - 应用最广泛。综合结果的时序性能和占用面积都不错，大器件的综合时间也相比XST有优势。但是非常贵，对新器件支持比XST晚一拍。
Precison - 没用过，不发表评论。
综合就是把HDL语言/原理图转换为综合网表的过程。
2. 什么是综合网表？
综合网表就是综合的结果啦。
综合网表的业界标准是EDIF格式。文件后缀通常为.edn, .edf, .edif。EDIF网表是可以用文本编辑器打开的文本文件。
Xilinx自家的综合结果是NGC网表。NGC网表是二进制的文件，不能用文本编辑器打开观察。
3. 综合网表中包含一些什么内容？
综合网表中除了包含从HDL语言中infer出的与门、非门等组合逻辑和寄存器等时序逻辑之外，还包含FPGA特有的各种原语(Primitive)比如LUT，BRAM，DSP48，甚至PowerPC，PCIe等硬核模块，以及这些模块的属性和约束信息。
4. 综合工具有哪些？
Xilinx自家的XST，Synopsys(收购了Synplicity)的Synplify，Mentor Graphic的Precision 都是使用最广泛的综合工具。
5. 这些综合工具有什么特点呢？
XST - 随ISE自带，免费，对新器件支持快。但是对loop循环支持不如Synpilfy。综合结果的时序有时没有Synplify好。
Synplify - 应用最广泛。综合结果的时序性能和占用面积都不错，大器件的综合时间也相比XST有优势。但是非常贵，对新器件支持比XST晚一拍。
Precison - 没用过，不发表评论。
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